基于ARM的嵌入式系统中从串配置FPGA的实现

1 引言

ARM(Advanced RISC Machines)既可以认为是一个公司。也可以认为是对一类微处理器的统称，还可以认为是一项技术。基于ARM技术的微处理器应用约占据了32位RISC微处理器75％以上的市场份额，ARM技术正在逐步渗入到人们生活的各个方面[1]。到目前为止，ARM微处理器及技术已经广泛应用到各个领域，包括工业控制领域、网络应用、消费类电子产品、成像和安全产品等。

FPGA(Field Programmable Gate Array)是一种高密度现场可编程逻辑器件，其逻辑功能是通过把设计生成的数据文件配置到器件内部的静态配置数据存储器(SRAM)来实现的。FPGA具有可重复编程性,能灵活实现各种逻辑功能。

基于SRAM工艺的FPGA具有易失性。系统掉电以后其内部配置数据容易丢失，因此需要外接ROM保存其配置数据，系统上电后必须重新配置数据才能正常工作。目前有两种方案可以实现，一种是使用专用的PROM，以Xilinx公司FPGA，XCFxx系列PROM为例,能够提供FPGA的配置时序，上电时自动加载PROM中的配置数据到FPGA的SRAM中;另一种是在含有微处理器的系统(如嵌入式系统)中采用其他非易失性存储器如E2PROM、Flash存储配置数据，微处理器模拟FPGA的配置时序将ROM中的数据置入FPGA。与第一种方案相比,该方案节省成本、缩小系统体积。适用于对成本和体积苛刻要求的系统。

在便携式虚拟仪器设计中，使用嵌入式系统和FPGA实现系统功能。嵌入式微处理器采用Samsung公司的ARM7TDMI系列处理器S3C44BOX：FPGA采用Xilinx公司的Spartan-3E系列XC3S100E,采用S3C44BOX完成对XC3S100E的配置。取得了良好效果。

2 从串配置的原理

2.1从串配置原理

Xilinx公司的Spartan-3E系列FPGA产品是采用90 nm工艺的2.5 V低电压FPGA器
件，具有高性能、低功耗、可无限次编写的特点。XC3S100E是Spartan-3E系列FPGA中的一款，总门数达10万门，可采用从串、主串、从并、主并、JTAG等模式对其进行配置[2]。XC3S100E与从串配置模式相关的主要引脚功能如下：

M[2：0]：配置模式选择。M2、M1、M0均接上拉电阻，即M[2：0]：111时为从串模式；

CCLK：配置时钟，微处理器提供时钟源,且上升沿有效：

DIN：串行配置数据输入：

DOUT：串行数据输出，用于菊花链式配置：

PROG_B：低电平异步复位FPGA内部逻辑，内部可配置：Memory完全复位后，该引脚指示高电平。

当此引脚为高时,才能配置FPGA：

INIT_B：由低电平到高电平跳变时，采样配置模式，即M[2：0]的值确定配置方式；配置过程中若出现配置错误，INIT_B将呈现低电平；

DONE：复位时为低电平。若配置成功,则为高电平。

2.2微处理器从串配置：FPGA的时序

FPGA的配置过程如下：

系统上电后，将PROG_B拉低以复位FPGA内部逻辑重新配置FPGA，充分复位内部逻辑后(约100μs)，将PROG_置高。

INIT_B为低电平，PROG_B拉高保持300ns后，FPGA将INIT_B置高。在INIT_B由低向高跳变的瞬间，采样配置模式M[2：0]。此系统采用从串配置模式。

在FPGA采样配置模式后,微处理器就可以向FPGA配置时钟CCLK和数据,在CCLK的上升沿,传输数据至DIN，数据字节先发送低位，再发送高位。配置过程中若发生错误，则INIT_B为低电平。

所有的配置数据传送完成，CRC校验无误。则DONE为高电平，否则为低电平。

DONE为高电平，FPGA释放全局三态(GTS)，激活I/O引脚，释放全部置位复位(GSR)和全局写使能(GWE)有效，开始执行配置区的逻辑。

微处理器从串配置FPGA的时序如图1所示。